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Détection de défauts des convertisseurs de puissance d’un système éolien et validation par prototypage « FPGA in the loop »

Résumé : Cet article propose une méthode innovante de détection de défauts des semi-conducteurs de puissance appliquée à une nouvelle topologie tolérante aux fautes de système éolien intégrant une Machine Asynchrone à Double Alimentation (MADA). Les objectifs de la méthode présentée sont de minimiser le temps entre l’apparition du défaut et son diagnostic et de la rendre insensible aux commutations des semi-conducteurs de puissance. Afin de détecter un interrupteur défaillant en moins de 10 μs, la méthode a été implantée sur une cible FPGA (Field programmable Gate Array). Un flot de conception permettant l’implantation sur FPGA est expliqué. Les résultats ainsi obtenus par prototypage rapide dit « FPGA in the loop » valident les performances de notre système éolien tolérant aux fautes.
Document type :
Journal articles
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https://hal.univ-lorraine.fr/hal-03568502
Contributor : Philippe Poure Connect in order to contact the contributor
Submitted on : Sunday, February 13, 2022 - 7:11:03 PM
Last modification on : Monday, March 21, 2022 - 8:47:40 AM
Long-term archiving on: : Saturday, May 14, 2022 - 6:17:52 PM

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GAILLARD_Arnaud_RIGE_2009.pdf
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Arnaud Gaillard, Philippe Poure, Shahrokh Saadate. Détection de défauts des convertisseurs de puissance d’un système éolien et validation par prototypage « FPGA in the loop ». European Journal of Electrical Engineering, Lavoisier, 2010, 13 (2), pp.179-207. ⟨10.3166/Geo.19.11-38⟩. ⟨hal-03568502⟩

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